ssis:architettura
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Linea 38: | Linea 38: | ||
* Sistema di elaborazione come insieme di unità | * Sistema di elaborazione come insieme di unità | ||
* Rappresentazione in base b e albegra di Boole | * Rappresentazione in base b e albegra di Boole | ||
+ | - Seminario 3 (22/ | ||
* Funzioni e reti Combinatorie, | * Funzioni e reti Combinatorie, | ||
- | - Seminario 3 (22/ | + | |
- | | + | |
* Macchine di Mealy e Moore | * Macchine di Mealy e Moore | ||
* Modello di unità di elaborazione: | * Modello di unità di elaborazione: | ||
- | * Livello FW: Microlinguaggi TS e PS | + | |
- | | + | * Interprete HW di specifiche FW: TS e PS |
- | * Interprete HW di specifiche FW TS e PS | + | |
* Metodologia di progettazione di PO e PC | * Metodologia di progettazione di PO e PC | ||
* Semplici esempi di Unità | * Semplici esempi di Unità | ||
- | | + | - Seminario 5 (03/ |
+ | * Sincronizzazione fra unità | ||
+ | | ||
+ | * Memorie | ||
+ | - Seminario 6 (06/ | ||
* Linguaggio Assembler | * Linguaggio Assembler | ||
- | - Seminario 5 (03/ | + | |
- | | + | - Seminario |
- | - Seminario | + | * Classifficazione delle istruzioni |
- | * xxx | + | * RISC e CISC |
- | - Seminario 7 (12/ | + | * Compilazione di un semplice linguaggio imperativo in assembler |
- | * xxx | + | * Funzioni: Il passaggio di parametri via registro e via memoria |
- | - Seminario 8 (19/ | + | - Seminario 8 (19/ |
- | * xxx | + | * Obiettivi, livelli |
+ | * Blocchi, pagine | ||
+ | * Località | ||
+ | * Prestazioni | ||
+ | * Indirizzamento e traduzione degli indirizzi |
ssis/architettura.1178300040.txt.gz · Ultima modifica: 27/06/2007 alle 12:16 (18 anni fa) (modifica esterna)